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WED3DG6466V-AD1 Datasheet Preview

WED3DG6466V-AD1 Datasheet

512MB - 64Mx64 SDRAM UNBUFFERED

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WED3DG6466V-AD1
512MB - 64Mx64 SDRAM UNBUFFERED
FEATURES
PC100 and PC133 compatible
Burst Mode Operation
Auto and Self Refresh capability
LVTTL compatible inputs and outputs
Serial Presence Detect with EEPROM
Fully synchronous: All signals are registered on the
positive edge of the system clock
Programmable Burst Lengths: 1, 2, 4, 8 or Full Page
3.3V ± 0.3V Power Supply
144 Pin SO-DIMM JEDEC
• Ultra-low package height:
AD1: 27.94 mm (1.1”)
NOTE: Because of the low package height, there are no termination resistors.
DESCRIPTION
The WED3DG6466V is a 64Mx64 synchronous DRAM
module which consists of eight 64Mx8 SDRAM components
in TSOP II package, and one 2K EEPROM in an 8 pin
TSSOP package for Serial Presence Detect which
are mounted on a 144 pin SO-DIMM multilayer FR4
Substrate.
* This product is subject to change without notice.
PIN CONFIGURATIONS (FRONT SIDE/BACK SIDE)
PINOUT
PIN FRONT PIN BACK PIN FRONT PIN BACK PIN BACK PIN BACK
1 VSS 2 VSS 49 DQ13 50 DQ45 97 DQ22 98 DQ54
3 DQ0 4 DQ32 51 DQ14 52 DQ46 99 DQ23 100 DQ55
5 DQ1 6 DQ33 53 DQ15 54 DQ47 101 VCC 102 VCC
7 DQ2 8 DQ34 55 VSS 56 VSS 103 A6 104 A7
9 DQ3 10 DQ35 57 NC 58 NC 105 A8 106 BA0
11 VCC 12 VCC 59 NC 60 NC 107 VSS 108 VSS
13 DQ4 14 DQ36 61 CKL0 62 CKE0 109 A9 110 BA1
15 DQ5 16 DQ37 63 VCC 64 VCC 111 A10 112 A11
17 DQ6 18 DQ38 65 RAS# 66 CAS# 113 VCC 114 VCC
19 DQ7 20 DQ39 67 WE# 68 NC 115 DQMB2 116 DQMB6
21 VSS 22 VSS 69 CS0# 70 A12 117 DQMB3 118 DQMB7
23 DQMB0 24 DQMB4 71 NC 72 NC 119 VSS 120 VSS
25 DQMB1 26 DQMB5 73 NC 74 CK1 121 DQ24 122 DQ56
27 VCC 28 VCC 75 VSS 76 VSS 123 DQ25 124 DQ57
29 A0 30 A3 77 NC 78 NC 125 DQ26 126 DQ58
31 A1 32 A4 79 NC 80 NC 127 DQ27 128 DQ59
33 A2 34 A5 81 VCC 82 VCC 129 VCC 130 VCC
35 VSS 36 VSS 83 DQ16 84 DQ48 131 DQ28 132 DQ60
37 DQ8 38 DQ40 85 DQ17 86 DQ49 133 DQ29 134 DQ61
39 DQ9 40 DQ41 87 DQ18 88 DQ50 135 DQ30 136 DQ62
41 DQ10 42 DQ42 89 DQ19 90 DQ51 137 DQ31 138 DQ63
43 DQ11 44 DQ43 91 VSS 92 VSS 139 VSS 140 VSS
45 VCC 46 VCC 93 DQ20 94 DQ52 141 SDA 142 SCL
47 DQ12 48 DQ44 95 DQ21 96 DQ53 143 VCC 144 VCC
PIN NAMES
A0 – A12
BA0-1
DQ0-63
CK0, CK1
CKE0
CS0
RAS#
Address Input (Multiplexed)
Select Bank
Data Input/Output
Clock Input
Clock Enable Input
Chip Select Input
Row Address Strobe
CAS#
WE#
DQMB0-7
Column Address Strobe
Write Enable
DQM
VCC Power Supply (3.3V)
VSS Ground
SDA Serial Data I/O
SCL Serial Clock
DNU Do Not Use
NC No Connect
July 2005
Rev. 3
1 White Electronic Designs Corporation • (602) 437-1520 • www.wedc.com




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WED3DG6466V-AD1
July 2005
Rev. 3
FUNCTIONAL BLOCK DIAGRAM
WE#
DQMB0
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DQMB1
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
DQMB2
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DQMB3
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
S0#
DQM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
DQM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
DQM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
DQM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
S WE
D0
S WE
D1
S WE
D2
S WE
D3
DQMB4
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DQMB5
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
DQMB6
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
DQMB7
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
DQM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
S WE
D4
DQM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
S WE
D5
DQM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
S WE
D6
DQM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
S WE
D7
NOTE: DQ writing may differ than described in this drawing,
however DQ/DQMB/CKE/S relationships must be
maintained as shown.
RAS#
CAS#
CKE0
BA0-BA1
A0-A12
VDD
VSS
RAS#: SDRAM D0-D7
CAS#: SDRAM D0-D7
CKE: SDRAM D0-D7
BA0-BA1: SDRAM D0-D7
A0-A12: SDRAM D0-D7
D0-D7
D0-D7
2
*CLOCK WIRING
CLOCK
INPUT
*CK0
*CK1
SDRAMS
4 - SDRAMS
4 - SDRAMS
*Wire per Clock Loading Table/Wiring Diagrams
SCL
SERIAL PD
A0 A1 A2
SDA
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Part Number WED3DG6466V-AD1
Description 512MB - 64Mx64 SDRAM UNBUFFERED
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