74161 Datasheet Text
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54161/74161
4 位二进制同步计数器(异步清除) 简要说明: 161 为可预置的 4 位二进制同步计数器, 共有 54/74161 和 54/74LS161 两种线路结 构型式,其主要电特性的典型值如下: w
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管脚图:
引出端符号: w w
型号 CT54161/CT74161 CT54LS161/CT74LS161
FMAX 32MHz 32MHz
PD 305mW 93mW
161 的清除端是异步的。当清除端 CLEAR 为低电平时,不管时钟 端 CLOCK 状态如何,即可完成清除功能。 161 的预置是同步的。 当置入控制器 LOAD 为低电平时, 在 CLOCK 上升沿作用下,输出端 QA-QD 与数据输入端 A-D 相一致。对于 54/74161,当 CLOCK 由低至高跳变或跳变前,如果计数控制端 ENP、 ENT 为高电平,则 LOAD 应避免由低至高电平的跳变,而 54/74LS161 无此种限制。 161 的计数是同步的, 靠 CLOCK 同时加在四个触发器上而实现的。 当 ENP、ENT 均为高电平时,在 CLOCK 上升沿作用下 QA-QD 同时变 化,从而消除了异步计数器中出现的计数尖峰。对于 54/74161,只 有当 CLOCk 为高电平时,ENP、ENT 才允许由高至低电平的跳变,而 54/74LS161 的 ENP、ENT 跳变与 CLOCK 无关。 161 有超前进位功能。当计数溢出时,进位输出端(RCO)输出 一个高电平脉冲,其宽度为 QA 的高电平部分。 在不外加门电路的情况下,可级联成 N 位同步计数器。 对于 54/74LS161,在 CLOCk 出现前,即使 ENP、ENT、CLEAR 发 生变化,电路的功能也不受影响。
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PCO CLOCK CLEAR ENP ENT ABCD LOAD QA -QD
进位输出端 时钟输入端(上升沿有效) 异步清除输入端(低电平有效) 计数控制端 计数控制端 并行数据输入端 同步并行置入控制端(低电平有效) 输出端 w
功能表:
极限值 电源电压------------------------------------------------ 7V 输入电压 54/74161 ----------------------------------------- 5.5V 54/74LS161 --------------------------------------- 7V ENP 与 ENT 间电压 54/74161 ----------------------------------------- 5.5V 工作环境温度 5 4×××------------------------------ - 55~125℃ 74×××------------------------------------0~70℃ 贮存温度-------------------------------------- -65~150℃ 推荐工作条件:
CT54161/CT74161 最小 54 电源电压 Vcc 74 输入高电平电压 VIH 输入低电平电压 VIL 输出高电平电流 IOH 54 74 4.75 2 0.8 0.8 -800 5 5.25 4.75 2 0.7 5 5.25 4.5 额定 5 最大 5.5 CT54LS161/CT74LS161 w w
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说明:H-高电平...