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White Electronic Designs Corporation

WED3DG64126V-D2 Datasheet Preview

WED3DG64126V-D2 Datasheet

1GB - 128M X 64 SDRAM Unbuffered

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WED3DG64126V-D2
1GB- 128Mx64 SDRAM UNBUFFERED
FEATURES
n Burst Mode Operation
n Auto and Self Refresh capability
n LVTTL compatible inputs and outputs
n Serial Presence Detect with EEPROM
n Fully synchronous: All signals are registered on the positive
edge of the system clock
n Programmable Burst Lengths: 1, 2, 4, 8 or Full Page
n 3.3 volt 6 0.3v Power Supply
n 168- Pin DIMM JEDEC
DESCRIPTION
The WED3DG64126V is a 128Mx64 synchronous DRAM module
which consists of sixteen 64Mx8 SDRAM components in TSOP-
11 package and one 2K EEPROM in an 8- pin TSSOP package for
Serial Presence Detect which are mounted on a 168 Pin DIMM
multilayer FR4 Substrate.
* This datasheet describes a product that may or may not be under development
and is subject to change or cancellation without notice.
PIN CONFIGURATIONS (FRONT SIDE/BACK SIDE)
Pin Front
1 VSS
2 DQ0
3 DQ1
4 DQ2
5 DQ3
6 VDD
7 DQ4
8 DQ5
9 DQ6
10 DQ7
11 DQ8
12 VSS
13 DQ9
14 DQ10
15 DQ11
16 DQ12
17 DQ13
18 VDD
19 DQ14
20 DQ15
21 *CB0
22 *CB1
23 VSS
24 NC
25 NC
26 VDD
27 WE
28 DQM0
Pin Front
29 DQM1
30 CS0
31 DNU
32 VSS
33 A0
34 A2
35 A4
36 A6
37 A8
38 A10/AP
39 BA1
40 VDD
41 VDD
42 CLK0
43 VSS
44 DNU
45 CS2
46 DQM2
47 DQM3
48 DNU
49 VDD
50 NC
51 NC
52 *CB2
53 *CB3
54 VSS
55 DQ16
56 DQ17
Pin Front
57 DQ18
58 DQ19
59 VDD
60 DQ20
61 NC
62 *VREF
63 CKE1
64 VSS
65 DQ21
66 DQ22
67 DQ23
68 VSS
69 DQ24
70 DQ25
71 DQ26
72 DQ27
73 VDD
74 DQ28
75 DQ29
76 DQ30
77 DQ31
78 VSS
79 CLK2
80 NC
81 WP***
82 **SDA
83 **SCL
84 VDD
Pin Back
85 VSS
86 DQ32
87 DQ33
88 DQ34
89 DQ35
90 VCC
91 DQ36
92 DQ37
93 DQ38
94 DQ39
95 DQ40
96 VSS
97 DQ41
98 DQ42
99 DQ43
100 DQ44
101 DQ45
102 VDD
103 DQ46
104 DQ47
105 *CB4
106 *CB5
107 VSS
108 NC
109 NC
110 VDD
111 CAS
112 DQM4
Pin Back
113 DQM5
114 CS1
115 RAS
116 VSS
117 A1
118 A3
119 A5
120 A7
121 A9
122 BA0
123 A11
124 VDD
125 CLK1
126 *A12
127 VSS
128 CKE0
129 CS3
130 DQM6
131 DQM7
132 *A13
133 VDD
134 NC
135 NC
136 *CB6
137 *CB7
138 VSS
139 DQ48
140 DQ49
Pin Back
141 DQ50
142 DQ51
143 VDD
144 DQ52
145 NC
146 *VREF
147 DNU
148 VSS
149 DQ53
150 DQ54
151 DQ55
152 VSS
153 DQ56
154 DQ57
155 DQ58
156 DQ59
157 VDD
158 DQ60
159 DQ61
160 DQ62
161 DQ63
162 VSS
163 CLK3
164 NC
165 **SA0
166 **SA1
167 **SA2
168 VDD
PIN NAMES
A0 – A12
BA0-1
DQ0-63
CLK0-CLK3
CKE0,CKE1
CS0-CS3
RAS
CAS
WE
DQM0-7
VDD
VSS
SDA
SCL
DNU
NC
WP
Address input (Multiplexed)
Select Bank
Data Input/Output
Clock input
Clock Enable input
Chip select Input
Row Address Strobe
Column Address Strobe
Write Enable
DQM
Power Supply (3.3V)
Ground
Serial data I/O
Serial clock
Do not use
No Connect
Write Protect
* These pins are not used in this module.
** These pins should be NC in the system which
does not support SPD.
*** WP available on the WED3DG63126V-D2 only.
Aug. 2002 Rev. 0
ECO #15455
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WED3DG64126V-D2
FUNCTIONAL BLOCK DIAGRAM
CS1
CS0
DQM0
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DQM1
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
CS3
CS2
DQM2
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DQM3
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U0
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U1
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U2
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U3
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U8
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U9
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U10
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U11
DQM4
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DQM5
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U4
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U5
DQM6
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
DQM7
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U6
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U7
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U12
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U13
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U14
DQM
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CS
U15
SCL
A0 A1 A2
SDA
WP
A0 ~ A12, BA0 & 1
RAS
CAS
WE
CKE0
DQn
SDRAM U0 ~ U15
VDD
SDRAM U0 ~ U15
SDRAM U0 ~ U15
10K
SDRAM U0 ~ U15 CKE1
SDRAM U0 ~ U7
·
SDRAM U8 ~ U15
10
Every DQpin of SDRAM
CLK0/1/2/3
VDD
··
Two 0.1uF Capacitors
per each SDRAM
To all SDRAMs
Vss · ·
SA0 SA1 SA2
10
·
1.5 pF
U0/U1/U2/U3
U4/U5/U6/U7
U8/U9/U10/U11
U12/U13/U14/U15
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2
Aug. 2002 Rev. 0
ECO #15455


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